恭喜博越微電子(江蘇)有限公司劉小威獲國家專利權
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龍圖騰網恭喜博越微電子(江蘇)有限公司申請的專利一種多并口PHY共享PLL的時鐘及控制方法獲國家發明授權專利權，本發明授權專利權由國家知識產權局授予，授權公告號為：CN119442997B 。
龍圖騰網通過國家知識產權局官網在2025-03-25發布的發明授權授權公告中獲悉：該發明授權的專利申請號/專利號為：202510027091.6，技術領域涉及：G06F30/3312；該發明授權一種多并口PHY共享PLL的時鐘及控制方法是由劉小威;劉德啟設計研發完成，并于2025-01-08向國家知識產權局提交的專利申請。
本一種多并口PHY共享PLL的時鐘及控制方法在說明書摘要公布了：本發明的目的是提供一種多并口PHY共享PLL的時鐘及控制方法，該方法包括：SOC鎖相環、多個PHY和多個內存控制器；所述SOC鎖相環與所述PHY和所述內存控制器連接，用于提供時鐘信號。本發明采用一套多個并口PHY共享外部PLL的時鐘方案，節省了芯片中PLL的數量，降低了芯片的面積和功耗，特別適用于面積較小，有超低功耗要求的芯片，不僅僅適用于單個并口PHY的系統，更適用于多并口PHY的系統，讓并口PHY在SoC系統中的集成方式變得更加靈活多樣化。
本發明授權一種多并口PHY共享PLL的時鐘及控制方法在權利要求書中公布了：1.一種多并口PHY共享PLL的時鐘，其特征在于，包括：SOC鎖相環、多個PHY和多個內存控制器；所述SOC鎖相環與所述PHY和所述內存控制器連接，用于提供時鐘信號；所述PHY還包括：24分頻的分頻器；所述24分頻的分頻器與所述SOC鎖相環和DFIPHY時鐘路徑連接，用于將輸入給PHY的高速時鐘進行分頻，產生一個內部的低速時鐘；所述PHY包括：DFI時鐘路徑和DFIPHY時鐘路徑；所述DFIPHY時鐘路徑的時鐘信號由所述SOC鎖相環直接提供；所述DFI時鐘路徑的時鐘信號由所述SOC鎖相環輸出的信號經過分頻電路后提供；所述DFI時鐘路徑包括由所述SOC鎖相環至PHY內部的第一觸發器和第四觸發器的時鐘信號輸入端；所述DFIPHY時鐘路徑包括由所述SOC鎖相環至PHY內部的第二觸發器和第三觸發器的時鐘信號輸入端。
如需購買、轉讓、實施、許可或投資類似專利技術，可聯系本專利的申請人或專利權人博越微電子(江蘇)有限公司，其通訊地址為：214000 江蘇省無錫市新吳區太湖國際科技園軟件園四期天鵝座C座709室；或者聯系龍圖騰網官方客服，聯系龍圖騰網可撥打電話0551-65771310或微信搜索“龍圖騰網”。
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2、報告中的分析和結論僅反映本公司于發布本報告當日的職業理解，僅供參考使用，不能作為本公司承擔任何法律責任的依據或者憑證。
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